华为发布“韬（τ）定律”：不靠缩小晶体管，靠压缩时间提升芯片性能
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2026-05-25 18:31:33
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5月25日，华为在IEEE国际电路系统研讨会（ISCAS 2026）上正式提出半导体演进新原则——“韬（τ）定律”，核心是以“时间（τ）缩微”替代传统的“几何缩微”，作为后摩尔时代半导体持续发展的指导方向。该定律将单一特征时间常数τ确立为从晶体管到数据中心的全栈统一优化目标，旨在突破传统制程微缩面临的物理极限与成本瓶颈。
在摩尔定律逐渐失效的背景下，晶体管尺寸逼近原子尺度，量子隧穿效应导致漏电与发热加剧，先进制程单芯片设计成本已超十亿美元。华为提出的τ缩微不依赖缩小物理尺寸，而是通过系统性降低信号传播的时间常数来提升性能与能效。关键技术“逻辑折叠”可突破平面布局限制，将关键路径走线长度大幅缩短，同时结合“软件、架构、芯片”全栈协同与灵衢总线互联协议，实现端到端执行时间的显著下降。
基于韬定律，华为过去六年已量产381款芯片，覆盖通信、计算、终端及车载等领域。即将于2026年秋季面世的麒麟芯片完整采用逻辑折叠技术，在固定工艺节点下晶体管密度从每平方毫米155兆颗提升至238兆颗，增幅55%；性能核功耗效率提升41%，最高主频提升近13%。华为预计，到2031年基于该定律的高端芯片晶体管密度将达到1.4纳米制程的同等水平。
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